iCE40/yosys - [no description]

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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Add additional test cases for for-loops	Clifford Wolf	2019-05-01	1	-0/+25
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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Silently resolve completely unused cell-vs-const driver-driver conflicts	Clifford Wolf	2019-05-01	1	-2/+21
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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Re-enable "final loop assignment" feature	Clifford Wolf	2019-05-01	1	-2/+0
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* \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Merge pull request #871 from YosysHQ/verific_import	Clifford Wolf	2019-05-06	4	-44/+181
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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Add tests/various/chparam.sh	Clifford Wolf	2019-05-06	1	-0/+52
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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Add "hierarchy -chparam" support for non-verific top modules	Clifford Wolf	2019-05-03	1	-12/+35
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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	log_warning_noprefix -> log_warning as per review	Eddie Hung	2019-05-03	1	-1/+1
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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	For hier_tree::Elaborate() also include SV root modules (bind)	Eddie Hung	2019-05-03	1	-23/+36
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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Fix verific_parameters construction, use attribute to mark top netlists	Eddie Hung	2019-05-03	2	-8/+12
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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	WIP -chparam support for hierarchy when verific	Eddie Hung	2019-05-03	3	-19/+41
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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	verific_import() changes to avoid ElaborateAll()	Eddie Hung	2019-05-03	1	-15/+38
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* \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Fix the other bison warning in ilang_parser.y	Clifford Wolf	2019-05-06	1	-1/+1
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* \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Bugfix in peepopt_shiftmul.pmg	Clifford Wolf	2019-05-06	1	-0/+4
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* \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Merge pull request #992 from bwidawsk/bison-fix	Clifford Wolf	2019-05-06	1	-1/+1
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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	verilog_parser: Fix Bison warning	Ben Widawsky	2019-05-05	1	-1/+1
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* \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Merge pull request #989 from YosysHQ/dave/abc_name_improve	Clifford Wolf	2019-05-06	1	-8/+21
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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	abc: Fix handling of postfixed names (e.g. for retiming)	David Shah	2019-05-04	1	-4/+4
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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	abc: Improve name recovery	David Shah	2019-05-04	1	-4/+17
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* \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Fix bug in "expose -input"	Clifford Wolf	2019-05-06	1	-1/+1
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* \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Cleanups in opt_clean	Clifford Wolf	2019-05-06	1	-47/+16
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* \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Merge pull request #988 from YosysHQ/clifford/fix987	Clifford Wolf	2019-05-04	2	-1/+5
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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Add approximate support for SV "var" keyword, fixes #987	Clifford Wolf	2019-05-04	2	-1/+5
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* \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Improve opt_clean handling of unused wires	Clifford Wolf	2019-05-04	1	-10/+22
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* \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Add support for SVA "final" keyword	Clifford Wolf	2019-05-04	2	-1/+5
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* \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Rename cells_map.v to prevent clash with ff_map.v	Eddie Hung	2019-05-03	1	-6/+8
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* \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	iverilog with simcells.v as well	Eddie Hung	2019-05-03	1	-1/+2
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* \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Merge pull request #969 from YosysHQ/clifford/pmgenstuff	Clifford Wolf	2019-05-03	13	-151/+509
\|\ \ \ \ \ \ \ \ \ \ \ \ \ \ \ \ \ \ \ \| \|/ / / / / / / / / / / / / / / / / / \|/\| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Improve pmgen, Add "peepopt" pass with shift-mul pattern
\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Update pmgen documentation	Clifford Wolf	2019-05-03	1	-6/+18
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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Fix typo	Clifford Wolf	2019-05-03	1	-1/+1
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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Add peepopt_muldiv, fixes #930	Clifford Wolf	2019-04-30	6	-1/+86
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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	pmgen progress	Clifford Wolf	2019-04-30	4	-13/+27
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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Run "peepopt" in generic "synth" pass and "synth_ice40"	Clifford Wolf	2019-04-30	2	-0/+4
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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Some pmgen reorg, rename peepopt.pmg to peepopt_shiftmul.pmg	Clifford Wolf	2019-04-30	3	-4/+6
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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Progress in shiftmul peepopt pattern	Clifford Wolf	2019-04-30	1	-3/+51
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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Add "peepopt" skeleton	Clifford Wolf	2019-04-29	5	-1/+112
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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Add pmgen support for multiple patterns in one matcher	Clifford Wolf	2019-04-29	3	-130/+188
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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Support multiple pmg files (right now just concatenated together)	Clifford Wolf	2019-04-29	1	-6/+30
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* \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Merge pull request #984 from YosysHQ/eddie/fix_982	Clifford Wolf	2019-05-03	1	-1/+2
\|\ \ \ \ \ \ \ \ \ \ \ \ \ \ \ \ \ \ \ \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	dffinit to do nothing when (* init *) value is 1'bx
\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Revert "synth_xilinx to call dffinit with -noreinit"	Eddie Hung	2019-05-03	1	-1/+1
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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	If init is 1'bx, do not add to dict as per @cliffordwolf	Eddie Hung	2019-05-03	1	-1/+2
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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Revert "dffinit -noreinit to silently continue when init value is 1'bx"	Eddie Hung	2019-05-03	1	-12/+4
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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	synth_xilinx to call dffinit with -noreinit	Eddie Hung	2019-05-02	1	-1/+1
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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	dffinit -noreinit to silently continue when init value is 1'bx	Eddie Hung	2019-05-02	1	-4/+12
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* \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Merge pull request #976 from YosysHQ/clifford/fix974	Clifford Wolf	2019-05-03	3	-0/+25
\|\ \ \ \ \ \ \ \ \ \ \ \ \ \ \ \ \ \ \ \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Fix width detection of memory access with bit slice
\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Add splitcmplxassign test case and silence splitcmplxassign warning	Clifford Wolf	2019-05-01	2	-0/+23
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\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Fix width detection of memory access with bit slice, fixes #974	Clifford Wolf	2019-05-01	1	-0/+2
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* \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Merge pull request #985 from YosysHQ/clifford/fix981	Clifford Wolf	2019-05-03	2	-44/+81
\|\ \ \ \ \ \ \ \ \ \ \ \ \ \ \ \ \ \ \ \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Improve opt_expr and opt_clean handling of (partially) undriven and/or unused wires
\| * \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Improve opt_expr and opt_clean handling of (partially) undriven and/or ↵	Clifford Wolf	2019-05-03	2	-44/+81
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* \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Fix typo in tests/svinterfaces/runone.sh	Clifford Wolf	2019-05-03	1	-2/+2
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* \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	Merge pull request #979 from jakobwenzel/svinterfacesTestcase	Clifford Wolf	2019-05-03	1	-2/+2
\|\ \ \ \ \ \ \ \ \ \ \ \ \ \ \ \ \ \ \ \| \|/ / / / / / / / / / / / / / / / / / \|/\| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \| \|	fail svinterfaces testcases on yosys error exit